!C99Shell v.2.1 [PHP 7 Update] [1.12.2019]!

Software: Apache/2.2.8 (Ubuntu) PHP/5.2.4-2ubuntu5.12 with Suhosin-Patch mod_ssl/2.2.8 OpenSSL/0.9.8g. PHP/5.2.4-2ubuntu5.12 

uname -a: Linux forum.circlefusion.com 2.6.24-19-server #1 SMP Wed Jun 18 15:18:00 UTC 2008 i686 

uid=33(www-data) gid=33(www-data) groups=33(www-data) 

Safe-mode: OFF (not secure)

/usr/src/linux-headers-2.6.24-28/include/asm-m68knommu/   drwxr-xr-x
Free 1.06 GB of 97.11 GB (1.09%)
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Viewing file:     m523xsim.h (1.65 KB)      -rw-r--r--
Select action/file-type:
(+) | (+) | (+) | Code (+) | Session (+) | (+) | SDB (+) | (+) | (+) | (+) | (+) | (+) |
/****************************************************************************/

/*
 *    m523xsim.h -- ColdFire 523x System Integration Module support.
 *
 *    (C) Copyright 2003-2005, Greg Ungerer <gerg@snapgear.com>
 */

/****************************************************************************/
#ifndef    m523xsim_h
#define    m523xsim_h
/****************************************************************************/


/*
 *    Define the 523x SIM register set addresses.
 */
#define    MCFICM_INTC0        0x0c00        /* Base for Interrupt Ctrl 0 */
#define    MCFICM_INTC1        0x0d00        /* Base for Interrupt Ctrl 0 */
#define    MCFINTC_IPRH        0x00        /* Interrupt pending 32-63 */
#define    MCFINTC_IPRL        0x04        /* Interrupt pending 1-31 */
#define    MCFINTC_IMRH        0x08        /* Interrupt mask 32-63 */
#define    MCFINTC_IMRL        0x0c        /* Interrupt mask 1-31 */
#define    MCFINTC_INTFRCH        0x10        /* Interrupt force 32-63 */
#define    MCFINTC_INTFRCL        0x14        /* Interrupt force 1-31 */
#define    MCFINTC_IRLR        0x18        /* */
#define    MCFINTC_IACKL        0x19        /* */
#define    MCFINTC_ICR0        0x40        /* Base ICR register */

#define    MCFINT_VECBASE        64        /* Vector base number */
#define    MCFINT_UART0        13        /* Interrupt number for UART0 */
#define    MCFINT_PIT1        36        /* Interrupt number for PIT1 */
#define MCFINT_QSPI        18        /* Interrupt number for QSPI */

/*
 *    SDRAM configuration registers.
 */
#define    MCFSIM_DCR        0x44        /* SDRAM control */
#define    MCFSIM_DACR0        0x48        /* SDRAM base address 0 */
#define    MCFSIM_DMR0        0x4c        /* SDRAM address mask 0 */
#define    MCFSIM_DACR1        0x50        /* SDRAM base address 1 */
#define    MCFSIM_DMR1        0x54        /* SDRAM address mask 1 */

/****************************************************************************/
#endif    /* m523xsim_h */

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